Prof. J. Walter - Informationstechnik, Mikrocomputertechnik, Digitale Medien Portbelegungsplan
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3D-KL Testverfahren
Wintersemester 2020
huya1011@hs-karlsruhe.de
Yannick Huebner

zur Softwaredokumentation

Portbelegungsplan


System 1 - System 2

NodeMCU
Port
I/O SX1509
Port
I/O Bezeichnung
D1 I/O SDA I/O Data
         
         
         
         
         
         

System 1 - System 3

NodeMCU
Port
I/O HX711
Port
I/O Bezeichnung
D1 I/O SDA I/O Data
         
         
         
         
         
         

 


  Mit Unterstützung von Prof. J. Walter Wintersemester 2020